Verilog程序设计与EDA

Verilog程序设计与EDA

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作者: 刘笃仁编 , 刘靳

出版社: 西安电子科技大学出版社

出版时间: 2012-09

版次: 1

ISBN: 9787560629100

定价: 25.00

装帧: 平装

开本: 16开

纸张: 胶版纸

页数: 215页

字数: 327千字

分类: 计算机与互联网

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刘靳和刘笃仁编著的《Verilog程序设计与EDA》除绪论外共分9章，主要内容包括：Verilog HDL的基本结构与描述方式、Verilo HDL 的基本要素、VerilogHDL的基本语句、组合电路设计、时序电路设计、仿真测试程序设计、组合电路设计实例、时序电路设计实例、EDA开发软件等。书中选用了相当数量的例题、实例，便于读者联系实际，举一反三，学习运用。《Verilog程序设计与EDA》可作为高等学校通信、电子工程、自动控制、工业自动化、检测技术及电子技术应用等相关电类专业本科和专科生Verilog HDL、EDA课程的教材和教学参考书，也可作为相关工程技术人员的学习参考书。绪论

  0.1  关于VerilogHDL

  0.2  关于EDA

第1章  VerilogHDL的基本结构与描述方式

  1.1  基本结构

  1.2  描述方式

  思考与习题

第2章  VerilogHDL的基本要素

  2.1  标识符（identifier）

  2.2  格式与注释

  2.3  数据

  2.4  数据类型

  2.5  操作符

  2.6  系统函数和系统任务

  2.7  编译预处理指令

  思考与习题

第3章  VerilogHDL的基本语句

  3.1  赋值语句

  3.2  块语句

  3.3  条件语句

  3.4  循环语句

  3.5  结构说明语句

  3.6  行为描述语句

  3.7  内置门语句

  3.8  内置开关语句

  3.9  用户定义原语UDP

  3.10  force强迫赋值语句

  3.11  specify延迟说明块

  3.12  关于verilog-2001新增的一些特性

  3.13  关于Verilog-2005

  思考与习题

第4章  组合电路设计

  4.1  简单组台电路设计

  4.2  复杂组合电路设计

  思考与习题

第5章  时序电路设计

  5.1  简单时序电路设计

  5.2  复杂时序电路设计

  思考与习题

第6章  仿真测试程序设计

  6.1  用VerilogHDL设计仿真测试程序

  6.2  用ABEL-HDL设计仿真测试向量

  思考与习题

第7章  组合电路设计实例

  7.1  编码器

  7.2  译码器

  7.3  数据选择器

  7.4  数据分配器

  7.5  数值比较器

  思考与习题

第8章  时序电路设计实例

  8.1  序列检测器

  8.2  脉冲分配器

  8.3  8路抢答器

  8.4  数字跑表

  8.5  交通灯控制系统

  8.6  以2递增的变模计数器

  8.7  定时器的Verilog编程实现

  8.8  ATM信元的接收及空信元的检测系统

  8.9  点阵汉字显示系统

  思考与习题

第9章  EDA开发软件

  9.1  Xilinx公司的EDA开发软件

  9.2  Lattice公司的EDA开发软件

  思考与习题

附录1  Verilog关键字

附录2  Nexys3DDigilent技术支持

附录3  Nexys3开发板

参考文献
内容简介:
刘靳和刘笃仁编著的《Verilog程序设计与EDA》除绪论外共分9章，主要内容包括：Verilog HDL的基本结构与描述方式、Verilo HDL 的基本要素、VerilogHDL的基本语句、组合电路设计、时序电路设计、仿真测试程序设计、组合电路设计实例、时序电路设计实例、EDA开发软件等。书中选用了相当数量的例题、实例，便于读者联系实际，举一反三，学习运用。《Verilog程序设计与EDA》可作为高等学校通信、电子工程、自动控制、工业自动化、检测技术及电子技术应用等相关电类专业本科和专科生Verilog HDL、EDA课程的教材和教学参考书，也可作为相关工程技术人员的学习参考书。
目录:
绪论

  0.1  关于VerilogHDL

  0.2  关于EDA

第1章  VerilogHDL的基本结构与描述方式

  1.1  基本结构

  1.2  描述方式

  思考与习题

第2章  VerilogHDL的基本要素

  2.1  标识符（identifier）

  2.2  格式与注释

  2.3  数据

  2.4  数据类型

  2.5  操作符

  2.6  系统函数和系统任务

  2.7  编译预处理指令

  思考与习题

第3章  VerilogHDL的基本语句

  3.1  赋值语句

  3.2  块语句

  3.3  条件语句

  3.4  循环语句

  3.5  结构说明语句

  3.6  行为描述语句

  3.7  内置门语句

  3.8  内置开关语句

  3.9  用户定义原语UDP

  3.10  force强迫赋值语句

  3.11  specify延迟说明块

  3.12  关于verilog-2001新增的一些特性

  3.13  关于Verilog-2005

  思考与习题

第4章  组合电路设计

  4.1  简单组台电路设计

  4.2  复杂组合电路设计

  思考与习题

第5章  时序电路设计

  5.1  简单时序电路设计

  5.2  复杂时序电路设计

  思考与习题

第6章  仿真测试程序设计

  6.1  用VerilogHDL设计仿真测试程序

  6.2  用ABEL-HDL设计仿真测试向量

  思考与习题

第7章  组合电路设计实例

  7.1  编码器

  7.2  译码器

  7.3  数据选择器

  7.4  数据分配器

  7.5  数值比较器

  思考与习题

第8章  时序电路设计实例

  8.1  序列检测器

  8.2  脉冲分配器

  8.3  8路抢答器

  8.4  数字跑表

  8.5  交通灯控制系统

  8.6  以2递增的变模计数器

  8.7  定时器的Verilog编程实现

  8.8  ATM信元的接收及空信元的检测系统

  8.9  点阵汉字显示系统

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  9.1  Xilinx公司的EDA开发软件

  9.2  Lattice公司的EDA开发软件

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